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  • Leinfelden-Echterdingen

    Abschlussarbeiten in Leinfelden-Echterdingen 2026 & 2027

    Leinfelden-Echterdingen (78 Ergebnisse)

    Logo von Advantest Advantest
    Senior Digital ASIC Design Engineer Synthesis (m/f/d)
    Böblingen
    Logo von Staatliche Toto-Lotto Baden-Württemberg Staatliche Toto-Lotto Baden-Württemberg
    Bachelor- oder Masterarbeit bei Lotto Baden-Württemberg
    Stuttgart
    Logo von Bosch Bosch
    Abschlussarbeit in Supply-Chain-Datenanalyse zur Sicherheitsrisikoerkennung
    Stuttgart
    Logo von Bosch Bosch
    Masterarbeit zur Erstellung eines Konzeptes für den Einsatz eines autonomen mobilen Manipulators für Handgalvanik-Prozesse
    Stuttgart
    Logo von Cenit Cenit
    Abschlussarbeit bei der CENIT AG (Initiativ)
    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Masterarbeit urbane Bioökonomie
    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Master Thesis: Development of a green reactor for wastewater treatment
    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Masterarbeit: Entwicklung eines grünen Reaktors zur Reinigung von Abwasser
    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Masterarbeit im Bereich Therapeutische Viren
    Stuttgart
    Logo von EXXETA EXXETA
    Thesis (Bachelor/Master) DevOps (all genders)
    Stuttgart
    +4 weitere Standorte
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Masterarbeit im Bereich Therapeutische Viren in Biberach
    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Bewirb Dich hier für eine Abschlussarbeit
    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
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    Stuttgart
    Logo von Fraunhofer-Gesellschaft Fraunhofer-Gesellschaft
    Masterarbeit im Bereich USP/DSP von Therapeutischen Viren am Standort Biberach
    Stuttgart
    Logo von Woodward Woodward
    Abschlussarbeit Versuch Injektoren für Power-to-X Kraftstoffe (m/w/d)
    Stuttgart
    Logo von Woodward Woodward
    Abschlussarbeit Versuch Druckerzeuger (m/w/d)
    Stuttgart
    Logo von Mercedes-Benz Group Mercedes-Benz Group
    Student*in für Bachelorarbeit Verwendung von KI in CAD-Templates
    Sindelfingen
    Logo von Bosch Bosch
    Thesis Rapid Gas Decompression Testing Up To 1000 Bar
    Renningen
    Logo von Bosch Bosch
    Masterarbeit Ermittlung der verfügbaren Sichtweite für die Berechnung komfortabler Motorradfahrgeschwindigkeiten
    Renningen
    Logo von Bosch Bosch
    Master Thesis Data-Efficient Hybrid Machine Learning for Robust Vibration System Prediction
    Renningen
    Karriereprofil erkunden
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    Schaeffler
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    Advantest
    Karriereprofil Advantest

    Böblingen: Senior Digital ASIC Design Engineer Synthesis (m/f/d)

    71032 Böblingen
    Jetzt bewerben

    Stellenbeschreibung

    Abschlussarbeit
    Homeoffice: Nach Absprache

    Job Description

    Join a global, highly skilled engineering team at the heart of Advantest’s cutting edge IC test solutions. As a Digital ASIC Design Engineer, you will help create the key technologies that enable the next generation of semiconductor testing.
    You will work on complex mixed signal ASICs used in Advantest’s industry leading testers, taking digital modules and subsystems from first concept all the way to silicon in the final system, giving you true end to end ownership.
    In this role, you will collaborate closely with system architects and design engineers. You will generate constraints for synthesis of IP blocks and the chip top level integration. You will analyze critical paths for robust designs, keep power consumption under control, solve challenging technical problems, and deliver high quality results on schedule and at scale.
    Job Duties & Responsibilities

    • Architecture development for CMOS designs
    • Design and RTL coding of digital and full-custom modules
    • Verification on module and chip level including test plan/cases generation.
    • Documentation of implemented functionality
    • Constraint generation and synthesis of IP blocks and the chip top level
    • Analysis of timing and power consumption
    • Support for floor-planning and physical design
    • Close collaboration with design partners

    Job Requirements

    • University degree, Diploma or BS EE
    • Background in digital design (SOC), Application Specific Integrated Circuit (ASIC) design methodologies and silicon development cycle
    • Experience in Register Transfer Level (RTL) coding (Verilog and System Verilog)
    • Experience with standard simulation tools for digital designs
    • Basic knowledge about UNIX* or Linux* environment and using programming languages
    • Technical communication, team work and problem solving skills
    • English language skills

      Job Details

    • Job Type: Full-time / Expat
    • Category: Research & Development (Hardware Development)
    Anstellungsart
    Abschlussarbeit
    Homeoffice
    Nach Absprache
    Standort
    71032 Böblingen
    Jetzt bewerben
    in neuem Tab öffnen
    Veröffentlicht am 28. Juli 2026
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